Stagiaire Ingénieur.e R&D algorithme de synchronisation F/H

Description de l'offre

Stagiaire Ingénieur.e R&D algorithme de synchronisation F/H

Company : Safran Data Systems

Job field : Software

Location : Les Ulis , Ile de France , France

Contract type : Internship / Student

Contract duration : Full-time

Required degree : Master Degree

Required experience : First experience

Spoken language(s) :

English Fluent

# SDS/STF/25/STAG-023-145756

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Job Description

Safran Data Systems, entité du groupe Safran, conçoit et fabrique une large gamme de produits et solutions dans les domaines de la télémesure bord & sol, du traitement embarqué de l'information, de l'acquisition et enregistrement de données, du contrôle satellite et de la télédétection.

Safran Data System (SDS) emploie plus de 700 salariés répartis en France (Les Ulis, Colombelles et Arcachon), en Allemagne et aux États-Unis.

La division Space & Communication (S&C) est spécialisée dans la maîtrise des télécommunications satellites et explorations spatiales au service de prestigieux partenaires comme l'ESA, la NASA, le CNES ou la JAXA en maîtrisant les liens Hyperfréquences (Antenne Satellite et Chaînes d'émissions/réception Hyper) ou encore des Modems Haut Débit pour l'imagerie spatiale et le contrôle satellite.

Dans le cadre de ses activités de recherche centrées sur les liaisons de données optiques spatiales, SDS propose à un.e étudiant.e un stage de dernière année de master afin d'étudier l'implémentation d'un nouvel algorithme d'égalisation sur sa plateforme FPGA embarquée dans un récepteur haut débit .

A ce titre, vous serez amené.e à parcourir l'état de l'art sur cette thématique, puis à comprendre une première implémentation Matlab de l'algorithme visé, pour finalement l'implémenter sur cible FPGA . Une implémentation C puis synthèse HLS pourra également être envisagée

Au cours de votre stage, vos missions principales seront les suivantes :

· 
Comprendre le fonctionnement de la chaine de réception

· 
Comprendre le code Matlab à implémenter sur cible

· 
Analyser et raffiner l'algorithme en fonction de contraintes fixes (Horloge FPGA, parallélisation amont, échantillonneur choisi, quantification, …)

· 
Application sur cible (connaissances en FPGA et en VHDL nécessaires).

· 
Mesurer les performances sur banc optique représentatif de la liaison Trans atmosphérique

Job Requirements

Vous préparez une dernière année de diplôme d'ingénieur ou de master (IMT Atlantique, Supelec, ENSEIRB,...).

Vous maitrisez les technologies FPGA, le langage VHDL et Matlab.

Si vous êtes à l'aise avec le langage C/C++ et/ou des connaissances générales en communication numérique, c'est un plus.

Vous êtes curieux.se et consciencieux.se dans votre travail et organisé.e dans votre code.

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5 Avenue des Andes91940

Les Ulis

Ile de France France

Safran is an Equal Opportunity Employer

All qualified applicants will receive consideration for employment without regard to race, color, sex, sexual orientation, gender identity, religion, national origin, disability, veteran status, or other legally protected status.